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Verilog (ヴェリログ) HDL&VHDLテストベンチ 2010年 10月号 [雑誌] 雑誌 – 2010/9/10

5つ星のうち 5.0 2件のカスタマーレビュー

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雑誌, 2010/9/10
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商品の説明

内容紹介

論理回路の検証で用いるHDL文法とノウハウ
Verilog HDL&VHDLテストベンチ記述の初歩

本書は,ハードウェア記述言語(HDL)によるテストベンチの記述にフォーカスした入門書です.
FPGAやASICの開発における検証では,シミュレーション手法が広く普及しています.
シミュレーションの際には,設計した回路に加えて,テストベンチと呼ばれるコードが必要になります.

本書ではテストベンチの記述の仕方を基本から説明しています.
Verilog HDLとVHDLの二つのハードウェア記述言語について,
テストベンチを記述するために必要な文法を解説し,多くの記述例を示しています.
また,複雑な検証を効率的に進める手法についても解説しています.


登録情報

  • 雑誌
  • 出版社: CQ出版; 不定版 (2010/9/10)
  • ASIN: B00414ZH72
  • 発売日: 2010/9/10
  • 梱包サイズ: 23.2 x 18 x 1.2 cm
  • おすすめ度: 5つ星のうち 5.0 2件のカスタマーレビュー
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2010年12月10日
Amazonで購入
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2013年12月2日
Amazonで購入